基于FPGA的高速模數轉換器評估系統
所屬分類(lèi):技術(shù)論文
上傳者:wwei
文檔大?。?span>4743 K
標簽: FPGA 模數轉換器 上位機
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文檔介紹:設計并驗證了一種基于現場(chǎng)可編程邏輯陣列(FPGA)的高速模數轉換器(ADC)評估系統?;贔PGA設計了底層邏輯,根據不同的測試指標控制ADC的信號采集和數據轉換,將模擬輸入信號轉換為數據存儲到FPGA的分布式存儲器(Block RAM)中,通過(guò)用戶(hù)數據報協(xié)議(UDP)將數據傳輸到電腦端的基于MATLAB開(kāi)發(fā)的上位機,由電腦中央處理器(CPU)負責處理計算數據并輸出測試結果到用戶(hù)界面上。以一款16位、采樣率100 MS/s的ADC為例,以該評估系統對ADC的各項參數指標進(jìn)行測試和分析。實(shí)驗結果表明,該系統可以實(shí)現高速、高精度ADC的測試和評估。
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