基于VHDL的AES加密算法的實(shí)現(xiàn) | |
所屬分類:參考設(shè)計(jì) | |
上傳者:wenhuawu | |
文檔大?。?span>49 K | |
所需積分:0分積分不夠怎么辦? | |
文檔介紹:隨著計(jì)算機(jī)和通信網(wǎng)絡(luò)的廣泛應(yīng)用,信息的安全性已受到人們的普遍重視。信息安全不僅僅局限于政治、軍事以及外交等領(lǐng)域,而且他與人們的日常生活也息息相關(guān)。接下來(lái)我們一起來(lái)研究AES算法的原理與通過(guò)VHDL語(yǔ)言如何在FPGA內(nèi)部實(shí)現(xiàn)AES算法。附件中是本來(lái)通過(guò)查看相關(guān)資料而總結(jié)出來(lái)的AES原理以及算法實(shí)現(xiàn),希望大家能共同研究本算法,一起來(lái)研究如何改進(jìn)該算法,共同開(kāi)發(fā)高效的VHDL程序來(lái)在FPGA中實(shí)現(xiàn)AES算法 | |
現(xiàn)在下載 | |
VIP會(huì)員,AET專家下載不扣分;重復(fù)下載不扣分,本人上傳資源不扣分。 |
Copyright ? 2005-2024 華北計(jì)算機(jī)系統(tǒng)工程研究所版權(quán)所有 京ICP備10017138號(hào)-2