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基于第三代電流傳輸器的濾波器設(shè)計[模擬設(shè)計][工業(yè)自動化]

提出一種基于第三代電流傳輸器（CCIII）的電流模式二階濾波器的實現(xiàn)方法，導(dǎo)出的電流模式連續(xù)時間二階濾波器結(jié)構(gòu)比較簡單，可實現(xiàn)低通、高通、帶通3種濾波。這3種濾波的無源和有源靈敏度較低。本文提出的電路基于TMSC 0.35 um CMOS工藝，在2.5 V電源電壓工作條件下，采用Hspice在LEVEL49模型參數(shù)下對整個電路進(jìn)行仿真。

發(fā)表于：8/16/2018

一種新型的無刷直流電動機(jī)換相控制算法[嵌入式技術(shù)][工業(yè)自動化]

在分析RC硬件濾波器及FIR數(shù)字濾波器的基礎(chǔ)上，設(shè)計了反電動勢過零硬件檢測電路和軟件檢測算法，并利用Matlab擬合換相角的頻率特性曲線將硬件預(yù)估和軟件計算得到的結(jié)果按隨電機(jī)運(yùn)行頻率變化的權(quán)重進(jìn)行融合，得到與實際更吻合的換相角。使用DSP控制器實現(xiàn)該算法，能在各種頻率下精確地控制BLDCM穩(wěn)定運(yùn)行。驗證了該方法的合理性和有效性，為無位置傳感器無刷直流電機(jī)的控制提供了一種新的方法。

發(fā)表于：8/16/2018

一種無源射頻識別編解碼電路的設(shè)計與驗證[微波|射頻][安防電子]

提出了一種基于ISO/IEC 14443協(xié)議的高頻13.56 MHz RFID芯片的數(shù)字編解碼電路結(jié)構(gòu)，采用Altera FPGA搭建驗證系統(tǒng)，進(jìn)行了系統(tǒng)設(shè)計的仿真與驗證。該電路實現(xiàn)了RFID標(biāo)簽芯片通信時所需要的副載波調(diào)制后曼徹斯特編碼和修正密勒碼的解碼，并為后端的協(xié)議棧電路設(shè)計了SPI從機(jī)通信接口。

發(fā)表于：8/16/2018

短溝道MOSFET的毫米波噪聲建模[模擬設(shè)計][通信網(wǎng)絡(luò)]

基于40 nm MOSFET的器件物理結(jié)構(gòu)，建立了統(tǒng)一的MOSFET毫米波噪聲模型，以此來表征漏極電流噪聲、感應(yīng)柵極電流噪聲以及兩者之間的互相關(guān)噪聲的特性。通過將柵極過載效應(yīng)引入高頻噪聲模型，使得統(tǒng)一模型具有良好的平滑性、準(zhǔn)確性和連續(xù)性。最后，將所建模型的仿真結(jié)果與傳統(tǒng)的高頻噪聲模型進(jìn)行對比，并且對比所建模型與傳統(tǒng)模型的四噪聲參數(shù)以及實測的數(shù)據(jù)來驗證模型的有效性和精準(zhǔn)性。

發(fā)表于：8/16/2018

1.9 GHz低電壓低功耗CMOS射頻低噪聲放大器的設(shè)計[模擬設(shè)計][通信網(wǎng)絡(luò)]

針對1.9 GHz PHS和DECT無線接入系統(tǒng)的應(yīng)用，提出了一種可工作于0.9 V低電壓的CMOS射頻低噪聲放大器，并對其電路結(jié)構(gòu)、噪聲及線性度等主要性能進(jìn)行分析。該電路基于傳統(tǒng)的折疊結(jié)構(gòu)低噪聲放大器，利用晶體管線性補(bǔ)償技術(shù)，實現(xiàn)了低壓低功耗下的高線性度。采用TSMC 0.18 um CMOS工藝模型設(shè)計與驗證。

發(fā)表于：8/16/2018

基于高層次綜合工具的BIST控制器設(shè)計[EDA與制造][數(shù)據(jù)中心]

存儲器內(nèi)建自測試（MBIST）技術(shù)在存儲器測試中具有廣泛應(yīng)用，針對傳統(tǒng)寄存器傳輸級描述語言設(shè)計BIST控制器的過程相對繁瑣、專用EDA工具定義算法的靈活性差和電路結(jié)構(gòu)固定等問題，提出采用高層次綜合工具設(shè)計BIST控制器的方法。以SRAM為對象，采用C語言描述MARCH算法，并采取端口分配、流水線優(yōu)化和數(shù)組分割等優(yōu)化方案完善設(shè)計。最后借助FPGA平臺驗證評估了高層次綜合工具輸出的RTL級代碼電路的功能可靠性和規(guī)?？煽匦浴Ｏ鄬τ趥鹘y(tǒng)的兩種方法，擺脫了算法實現(xiàn)和電路結(jié)構(gòu)設(shè)計的局限性，縮短了算法實現(xiàn)周期。

發(fā)表于：8/16/2018

基于FPGA的實時QRS波檢測系統(tǒng)設(shè)計[可編程邏輯][醫(yī)療電子]

根據(jù)在線心電信號自動分析系統(tǒng)的實時性要求，提出了一種基于現(xiàn)場可編程門陣列的QRS波檢測解決方案和硬件結(jié)構(gòu)。該方案采用離散小波變換（DWT）算法結(jié)合閾值檢測算法進(jìn)行特征點(diǎn)提取，克服了傳統(tǒng)算法受噪聲、基漂、雜波等影響的缺點(diǎn)，邏輯簡單，適合硬件實現(xiàn)。

發(fā)表于：8/16/2018

Prewitt圖像邊緣檢測及邊緣細(xì)化的FPGA實現(xiàn)[可編程邏輯][通信網(wǎng)絡(luò)]

針對實時圖像處理的要求，使用FPGA對圖像數(shù)據(jù)流進(jìn)行在線Prewitt邊緣檢測。針對傳統(tǒng)算法需要人工給定閾值和產(chǎn)生的邊緣較寬的不足，用基于FPGA的自適應(yīng)閾值算法和非極大值抑制方法對邊緣檢測的結(jié)果進(jìn)行細(xì)化處理，提高了邊緣檢測的精度。

發(fā)表于：8/16/2018

基于GPS的遠(yuǎn)程心電監(jiān)護(hù)定位系統(tǒng)的設(shè)計[通信與網(wǎng)絡(luò)][醫(yī)療電子]

設(shè)計了一種基于GPS的遠(yuǎn)程心電監(jiān)護(hù)定位系統(tǒng)。提出了一種基于GPS的遠(yuǎn)程心電監(jiān)護(hù)定位系統(tǒng)的設(shè)計,介紹其硬件結(jié)構(gòu)的總體框架, 重點(diǎn)介紹了心電監(jiān)護(hù)定位系統(tǒng)終端的硬件電路設(shè)計和軟件設(shè)計思想。該系統(tǒng)充分利用CDMA網(wǎng)絡(luò)的技術(shù)和資源優(yōu)勢實現(xiàn)對病人隨時隨地的監(jiān)護(hù)。

發(fā)表于：8/16/2018

基于FPGA的新型高性能永磁同步電機(jī)驅(qū)動系統(tǒng)設(shè)計[可編程邏輯][工業(yè)自動化]

提出了一種基于FPGA的單芯片驅(qū)動控制方案。它采用硬件模塊化的現(xiàn)代EDA設(shè)計方法，使用VHDL硬件描述語言，實現(xiàn)了永磁同步電機(jī)矢量控制系統(tǒng)的設(shè)計。

發(fā)表于：8/16/2018

基于FPGA的方向濾波指紋圖像增強(qiáng)算法實現(xiàn)[可編程邏輯][安防電子]

設(shè)計了一種基于FPGA純硬件方式實現(xiàn)方向濾波的指紋圖像增強(qiáng)算法。采用寄存器傳輸級（RTL）硬件描述語言（Verilog HDL），利用時分復(fù)用和流水線處理等技術(shù)完成了方向濾波指紋圖像增強(qiáng)算法在FPGA上的實現(xiàn)。系統(tǒng)通過了Modelsim的仿真驗證，并在Terasic公司的DE2平臺上完成了硬件測試。

發(fā)表于：8/16/2018

基于混沌特性的跳頻序列復(fù)雜度分析[通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

對于已有的跳頻序列復(fù)雜度分析方法，通過分析跳頻序列的混沌特性，提出了一種用關(guān)聯(lián)維數(shù)度量跳頻序列復(fù)雜度的方法，該方法能夠?qū)M足混沌特性的跳頻序列進(jìn)行復(fù)雜度分析，為跳頻序列復(fù)雜度的度量提供了一種新的參考依據(jù)。最后對基于L-G非連續(xù)抽頭模型和Logistic-Kent級聯(lián)映射構(gòu)造的跳頻序列進(jìn)行了基于混沌特性的復(fù)雜度分析，并對兩者的復(fù)雜度進(jìn)行了比較。

發(fā)表于：8/15/2018

一種基于IEEE 802.11p系統(tǒng)的聯(lián)合粗細(xì)時間同步算法[通信與網(wǎng)絡(luò)][汽車電子]

提出了一種基于IEEE 802.11p標(biāo)準(zhǔn)的在高速車載移動環(huán)境下保持良好時間同步性能的聯(lián)合粗細(xì)時間同步方法。粗時間同步是基于短前導(dǎo)碼的自相關(guān)，細(xì)時間同步利用了滑動窗口和互相關(guān)技術(shù)來完成準(zhǔn)確的時間同步。MATLAB仿真結(jié)果表明，所提出的方案在車輛速度為89.7 km/h與 200.1 km/h時比其他三種同步方案的誤比特率減少了12.5%；在車輛速度為126.3 km/h~200.1 km/h時，同步位置的均方差比其他三種同步方案減少了20.1%。

發(fā)表于：8/15/2018

基于多比特帶通△∑調(diào)制器的射頻數(shù)字功放[微波|射頻][航空航天]

為提高射頻功放的線性和效率，提出了一種基于多比特帶通△∑調(diào)制器（BPDSM）的射頻數(shù)字功放結(jié)構(gòu)并給出了BPDSM的設(shè)計方法。針對調(diào)制器CRFB實現(xiàn)結(jié)構(gòu)中關(guān)鍵路徑過長的問題，利用重定時、流水線和超前計算等技術(shù)對實現(xiàn)結(jié)構(gòu)進(jìn)行了改進(jìn)，將BPDSM的實現(xiàn)速率提高至200 MHz。提出了多電平開關(guān)功放的電路結(jié)構(gòu)，將多個具有獨(dú)立電源的開關(guān)功放單元進(jìn)行串聯(lián)，實現(xiàn)了對BPDSM輸出多比特脈沖信號的高效開關(guān)放大。最后,利用FPGA器件及分立元件實現(xiàn)了頻率為30 MHz的數(shù)字功放，輸出功率為10 W時效率達(dá)到60%。

發(fā)表于：8/15/2018

1 W微波無線輸電系統(tǒng)的發(fā)射端設(shè)計[微波|射頻][通信網(wǎng)絡(luò)]

介紹了一種小功率(1 W)、2.45 GHz微波無線輸電系統(tǒng)的發(fā)射端設(shè)計。直流電平經(jīng)過鎖相頻率合成芯片ADF4360-0轉(zhuǎn)換為S波段的2.45 GHz微波信號，ADF4360-0的寄存器配置由MSP430控制；2.45 GHz微波信號經(jīng)過由功放芯片ERA-5SM及ADL5606組成的驅(qū)動級功率放大器將功率放大到1 W，加上喇叭天線即組成了小功率微波輸電系統(tǒng)的發(fā)射端。利用矩形微帶整流天線接收并整流微波信號，整流后的直流電平供給負(fù)載，便形成了完整的微波無線輸電系統(tǒng)。詳細(xì)分析了設(shè)計參數(shù)與方法，并進(jìn)行了仿真及驗證試驗。

發(fā)表于：8/15/2018