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如何快速定位线路网络故障?[测试测量][汽车电子]

DTF（distance tofault）,是故障定位的意思，是一种用于天线传输线路服务维护、线路性能验证以及故障分析的工具。DTF中运用了频域反射（FDR）测量技术。FDR是一种传输线路故障隔离方法，可精确识别同轴电缆和波导传输线路的信号路径衰减。能够精确定位故障和系统性能下降，而不仅仅是线路断路或短路的情况。可以迅速识别线路连接不良、电缆损坏或天线故障等造成的影响。

發(fā)表于：2018/4/25

用于ADF7023和ADF7023-J的AES加密与解密[模拟设计][物联网]

本文说明ADF7023和ADF7023-J收发器可用的高级加密标准(AES)固件模块（在下文中，提到ADF7023的内容也适用于ADF7023-J）。可下载的AES固件模块支持密钥大小为128位、192位和256位的128位块加密和解密。它支持两种模式：电码本(ECB)模式和密码块链接(CBC)模式1。

發(fā)表于：2018/4/25

发散式冲击波能流密度的测定[测试测量][医疗电子]

发散式冲击波作为一种新兴的医疗技术，在骨科、运动医学等领域具有独特优势，然而目前缺少统一的指标用于表征其临床治疗强度。在分析了发散式冲击波产生原理的基础上，提出将能流密度作为其临床治疗强度的评价指标。搭建高精度水下动态压力测量系统，对发散式冲击波的压力波形进行测定，再利用激光多普勒测振仪对波源的振动波形进行精准测量，对比两者，验证了实验系统所测压力波形的正确性。最后根据测得的压力波形计算能流密度，将其作为冲击波强度的表征指标，有效减少了同时调节多个参数的盲目性。该研究对其临床应用具有重要意义。

發(fā)表于：2018/4/25

基于改进车底阴影提取算法的前方运动车辆实时检测[测试测量][汽车电子]

道路前方运动车辆检测是汽车安全辅助驾驶的重要方面，开发鲁棒性强的实时检测方法是实现主动安全预警的有效途径。基于单目视觉和车道线确定梯形感兴趣区域（Region of Interest，ROI），并根据车底阴影特征，提出一种变矩形窗口的自适应均值-方差差值法，用于计算车底阴影阈值；进而，提出一种基于车辆尾部宽度模版的横向遍历最小均值法，生成车底阴影与路面相交线假设；再利用车底阴影的灰度值特征，对车底阴影线进行验证，从而检测出车辆。将上述方法应用于自行开发的DSP实验平台进行验证，结果表明，该方法平均计算周期仅38.46 ms，且在不同的交通环境、天气情况下均能较好地检测出车辆，具有较好的实时性和较强的鲁棒性。

發(fā)表于：2018/4/25

基于模糊路径纠偏的AGV视觉精定位研究[测试测量][汽车电子]

针对传统自主导航车(AGV)无法满足高精度路径跟踪和关键点精确定位问题，首次提出一种基于模糊控制的路径纠偏和二维码的关键点精确定位的组合方法。首先建立AGV四轮差动运动学模型，以位置偏差和角度偏差作为输入，纠偏控制量为输出设计一个二维模糊控制器实现快速纠偏。另外针对特殊点位高精度定位需求，根据每帧采样图片的尺寸固定这一特点建立基准坐标模型，通过三点定位法获取二维码轮廓，然后利用中心点的偏移计算误差，实现精确定位。

發(fā)表于：2018/4/24

多模态意识任务的脑电信号空间源定位分析[测试测量][医疗电子]

为了分析附加汉字默读的多模态意识任务所激活的大脑皮层，采用空间源定位分析与意识任务相关的脑电信号。首先采用独立分量分析算法将所有电极的脑电信号分解为各自独立的分量，每个分量可视为来自一个等价偶极子，并确定其在大脑皮层的位置和和方向；然后通过时频分析确定与意识任务相关的偶极子；最终分析和对比多模态意识任务和单模态意识任务之间偶极子的差异。对10位受试者进行实验，结果分析表明，与两个多模态意识任务相关的偶极子平均数量分别为5和4.3，均多于单模态任务，且偶极子数量的排序与这4个任务平均分类准确率一致，说明更多大脑皮层的激活有利于提高分类准确率，并验证了该实验的有效性和合理性。

發(fā)表于：2018/4/24

几种基于PLC的硅片清洗设备流量控制方法[可编程逻辑][工业自动化]

主要讲述了在半导体硅片清洗设备中常用的几种流量控制方法，主要包括工艺腔室和药液配比的流量控制，然后根据不同应用场景提出了对应使用的控制方法。单腔室硅片清洗机直接采用流量作为反馈信号进行闭环控制,通过控制喷洒和返回管路开度的平衡，有利于降低气动阀切换时液体流量的波动幅度。多腔室清洗机采用压力闭环的控制方式来间接控制流量, 磁悬浮泵串联控制设计可有效提升泵的使用寿命和压力稳定性，并通过调节各腔室针阀，减小了各个腔室工艺流量的差异性。多种药液配比功能一般通过控制各药液的注入流量来实现，流量精度直接影响药液成分的精度。基于可编程逻辑控制器（Programmable Logic Controller，PLC）的设备集成控制具有使用灵活、稳定性好、可靠性高的特点，适用于不同控制单元的实时、精确控制。

發(fā)表于：2018/4/23

乒乓球/羽毛球运动状态识别手表的设计[嵌入式技术][物联网]

为了弥补市场上现有产品缺少对乒乓球和羽毛球运动状态识别的现状，设计了一个佩戴于持球拍手腕就可以识别这两种运动中多种状态的手表。其硬件主要采用STM32F103C8T6单片机、MPU6050传感器、蓝牙串口模块。运动状态识别实现方法：由3轴加速度和3轴角速度计算出以大地坐标为参考系的3轴角度，数据经过高通滤波、平滑、数据分窗的预处理后进行特征值提取；再依据随机森林分类识别算法，识别乒乓球、羽毛球运动过程中的多种状态。该手表具有硬件成本低、体积小、功耗低等特点，经过测试，其识别率可达90%以上。

發(fā)表于：2018/4/23

高速数字振动信号无线接收螺旋缓冲算法[嵌入式技术][通信网络]

nRF24L01+无线设备将数据以32 B作为一个数据包进行传输，但在上位机接收之后经常发生数据包粘连和不连续，致使在下一次接收之后出现数据不完整。以磨机采集信号和无线传输系统为例，系统需要振动产生的数据信号连续不断地被传送进来，且要保证数据包的间隔一致。为保证接收数据的完整性和实时性，提出一种螺旋缓冲区域模型，该模型构造出一个环状队列，可以临时性地存储一定量的数据，这些数据在环形队列中时，就可以随时对数据进行操控。经过球磨机筒体振动信号采集和传输装置验证，数据仅在不同步时刻发生丢失，大大降低了接收数据的错误率，为大数据量的接收提供了一种稳定机制。

發(fā)表于：2018/4/20

基于三层级低开销的FPGA多比特翻转缓解技术[可编程逻辑][其他]

商用现货型FPGA被认为是解决目前空间应用对处理能力需求不断增加的唯一途径，由于其对多比特翻转的敏感性，需要针对空间应用的单粒子效应采取专门的设计加固技术。提出了基于用户逻辑层、配置存储器层和控制层3个层级的容错技术框架。在用户逻辑层，提出了一种新型的低开销的FTR策略用于用户逻辑的错误检测；在配置存储器级，提出了基于模块和帧的动态部分可重构策略用于处理配置存储器的错误；在控制级，以Xilinx ZYNQ片上系统型FPGA为目标，利用其嵌入的硬核处理器进行基于检查点和卷回体制的电路状态保存和恢复。整个容错技术框架在7级流水的LEON3开源器处理器中进行了故障注入的试验验证，试验结果显示在增加85%的LUT资源和125%的触发器资源使用条件下，99.997%注入的故障得到了及时纠正。

發(fā)表于：2018/4/20

ITECH并联均流电源，安全增加驱动力[电源技术][汽车电子]

在电子设备的实际测试过程中, 因单台供电电源的输出电压、电流，功率等无法满足要求，工程师通常会选择将多个电源并联运行，以增加系统驱动力及测试灵活性。但普通电源并联后，存在电流输出不均衡，动态响应延迟等各种问题，这样就会引起整个系统效率低下甚至崩溃.因此并联均流技术是当前电力电子技术发展的一大重点, 艾德克斯IT6500C系列电源，突破传统电源技术瓶颈，其内置硬件环路，确保主从模式支持并联，且主动均流，每个电源平等均分负载电流。从而安全扩展功率或电流的输出能力，且并联后，依然保持单机优异的动态特性。用户可任意指定恒电压CV 或恒电流 CC工作模式，安全扩展输出能力，从而满足多种大功率高速测试下的需求。

發(fā)表于：2018/4/19

JESD204B Subclass1模式时钟设计与调试[模拟设计][其他]

JESD204B协议是用于数据转换器与FPGA/ASIC之间数据传输的高速串行协议，Subclass1模式是该协议完成确定性延时功能的重要模式。对JESD204B协议Subclass1模式的工作原理和时钟设计要求进行分析，并总结出Subclass1模式时钟调试方法。利用Xilinx Virtex-7系列FPGA搭建JESD204B自收发链路对该方法进行验证。结果表明，该时钟调试方法能够满足Subclass1模式的时钟设计要求，保证数据的稳定收发。

發(fā)表于：2018/4/19

基于ZYNQ的Retinex实时图像去雾[嵌入式技术][其他]

雾霾天气严重影响户外视频系统的图像质量。随着户外视频系统的广泛和深入的应用，迫切需要能够进行实时处理的小型化的嵌入式图像去雾系统。提出一种基于ZYNQ的Retinex实时图像去雾方法，在HSV颜色空间对亮度分量V进行Retinex算法去雾处理；采用ARM+FPGA软硬件协同的方式，由ARM完成算法控制功能及图像的颜色空间转换、对数等简单运算；在FPGA中采用高斯核函数与二维图像卷积的并行算法估计环境光的照度。实验结果表明，提出的方法在保证去雾效果的情况下，具有处理速度快、小型化、可嵌入、可移植和功耗低等优点，能够满足户外视频系统的性能要求。

發(fā)表于：2018/4/19

基于Testbench的FPGA实物自动化测试环境设计[嵌入式技术][其他]

针对FPGA软件测试过程中仿真测试和实物测试的不足，提出了一种基于仿真测试用例的实物自动化测试环境，将用于仿真测试的Testbench进行解析处理，形成能够用于FPGA实物测试的传输信号，通过执行器将此信号转换为作用于被测FPGA芯片的实际信号，并采集被测FPGA芯片的响应，实现对FPGA的实物自动化测试。采用实物自动化测试环境验证平台对设计架构进行了验证，取得了良好的效果。

發(fā)表于：2018/4/18

一种具有新型延时单元的鉴频鉴相器设计[模拟设计][其他]

鉴频鉴相器是电荷泵锁相环的关键模块。死区表征鉴频鉴相器对两个输入信号最小相位差的鉴别能力，会使锁相环的杂散特性恶化，是鉴频鉴相器主要的设计考虑之一。基于TSMC 0.18 μm RF CMOS工艺，设计了一款具有新型延时单元的无死区鉴频鉴相器。该延时单元基于传输门及反相器设计，利用3位数字控制，实现8种不同的复位延时，可灵活配置，有效消除死区。其具备占用面积小、结构简单、易扩展和易移植等特点。仿真结果表明，设计的鉴频鉴相器具备消除死区的能力，能够应用于锁相环电路。

發(fā)表于：2018/4/18