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基于FPGA的視頻處理硬件平臺設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的視頻處理硬件平臺設(shè)計(jì)與實(shí)現(xiàn)

為了滿足機(jī)載顯示器畫面顯示多元化的要求，提出了一種基于FPGA的視頻轉(zhuǎn)換與疊加技術(shù)，該技術(shù)以FPGA為核心，搭配解碼電路及信號轉(zhuǎn)換電路等外圍電路，可實(shí)現(xiàn)XGA與PAL模擬視頻信號轉(zhuǎn)換為RGB數(shù)字視頻信號，并且與數(shù)字圖像信號疊加顯示，具有很強(qiáng)的通用性和靈活性。實(shí)驗(yàn)結(jié)果表明，視頻轉(zhuǎn)換與疊加技術(shù)能夠滿足機(jī)載顯示器畫面顯示的穩(wěn)定可靠、高度集成等要求，具備較高的應(yīng)用價值。

FPGA學(xué)習(xí)中的好書推薦

回想起自己學(xué)FPGA，已經(jīng)有一段時間了，從開始的茫然，到后來的瘋狂看書，設(shè)計(jì)開發(fā)板，調(diào)電路，練習(xí)各種FPGA實(shí)例，到最后能獨(dú)立完成項(xiàng)目，一路走來，感受頗多，拿出來和大家分享，順便介紹下自己的一點(diǎn)經(jīng)驗(yàn)所得，希望對初學(xué)者有所幫助。

發(fā)表于：2016/9/14

基于5G無線通信的稀疏碼多址接入系統(tǒng)的FPGA實(shí)現(xiàn)

在理解無線通信多址接入的基礎(chǔ)之上，提出了一種低復(fù)雜度的基于5G無線通信的稀疏碼多址接入系統(tǒng)的FPGA實(shí)現(xiàn)方案，利用可綜合的Verilog語言在QuartusII及ModelSim平臺下完成了電路的設(shè)計(jì)綜合仿真及FPGA驗(yàn)證，結(jié)果證明該設(shè)計(jì)實(shí)現(xiàn)功能完備，可以實(shí)際應(yīng)用。

發(fā)表于：2016/9/8

Xilinx收購Auviz FPGA與GPU要開戰(zhàn)了

Auviz Systems專注于數(shù)據(jù)中心和嵌入式系統(tǒng)的加速應(yīng)用，在卷積神經(jīng)網(wǎng)絡(luò)方向有著一定的技術(shù)積累。其技術(shù)專長是FPGA實(shí)現(xiàn)、機(jī)器學(xué)習(xí)、視覺算法等，為行業(yè)提供基于FPGA的中間件IP，以減少應(yīng)用程序的功耗。

發(fā)表于：2016/9/8

千萬門級模塊魚骨型時鐘網(wǎng)絡(luò)的實(shí)現(xiàn)

在芯片規(guī)模越來越大的背景下，針對千萬門級以上規(guī)模芯片模塊，提出一種基于單魚骨型時鐘網(wǎng)絡(luò)的改進(jìn)型時鐘結(jié)構(gòu)，并給出在后端設(shè)計(jì)過程中基于EDA工具的具體實(shí)現(xiàn)方法。

發(fā)表于：2016/9/5

高人詳解FPGA學(xué)習(xí)的四大要點(diǎn)！

FPGA為什么是可以編程的？恐怕很多菜鳥不知道，他們也不想知道。因?yàn)樗麄冇X得這是無關(guān)緊要的。他們潛意識的認(rèn)為可編程嘛，肯定就是像寫軟件一樣啦。軟件編程的思想根深蒂固，看到Verilog或者VHDL就像看到C語言或者其它軟件編程語言一樣。一條條的讀，一條條的分析。如果這些菜鳥們始終拒絕去了解為什么FPGA是可以編程的，不去了解FPGA的內(nèi)部結(jié)構(gòu)，要想學(xué)會FPGA恐怕是天方夜譚。

發(fā)表于：2016/9/2

GPT在異構(gòu)系統(tǒng)架構(gòu)（HSA）全球峰會上發(fā)布其最新進(jìn)展

中國北京，2016年8月21日 - 華夏芯公司的美國分部——通用處理器技術(shù)有限公司（GPT）是全球領(lǐng)先的異構(gòu)系統(tǒng)處理器IP授權(quán)商。GPT今日宣布，其IP核已經(jīng)在硅片上成功實(shí)現(xiàn)，并已通過HSA（異構(gòu)系統(tǒng)架構(gòu)）一致性測試。公司還宣布了新的機(jī)器學(xué)習(xí)和深層神經(jīng)網(wǎng)絡(luò)的開源項(xiàng)目，旨在進(jìn)一步推動HSA技術(shù)的發(fā)展。

發(fā)表于：2016/8/30

HSA峰會召開在即，報(bào)名參會人員遠(yuǎn)超預(yù)期

2016年全球異構(gòu)計(jì)算HSA峰會將于8月22日在北京拉開帷幕，本次峰會為期兩天，由全球異構(gòu)系統(tǒng)架構(gòu)（HSA）聯(lián)盟和中國半導(dǎo)體行業(yè)協(xié)會（CSIA）共同主辦，并得到了網(wǎng)信辦、工信部和北京經(jīng)濟(jì)技術(shù)開發(fā)區(qū)的大力支持。本次峰會受到了中國半導(dǎo)體業(yè)界的高度關(guān)注，目前報(bào)名申請參會人數(shù)已經(jīng)遠(yuǎn)超出之前的預(yù)期。

發(fā)表于：2016/8/22

FPGA設(shè)計(jì)寶典之提高算法速度的六大絕招

面積和速度這兩個指標(biāo)貫穿著FPGA設(shè)計(jì)的始終,是設(shè)計(jì)質(zhì)量評價的終極標(biāo)準(zhǔn)?！懊娣e”：指一個設(shè)計(jì)所消耗的FPGA的邏輯資源數(shù)量。FPGA中的邏輯資源,也就是觸發(fā)器( FF)和查找表(LUT) ?！八俣取保菏侵冈O(shè)計(jì)結(jié)果在芯片上穩(wěn)定運(yùn)行時所能達(dá)到的最高頻率,這個頻率由設(shè)計(jì)的時序狀況決定。與設(shè)計(jì)滿足的時鐘周期、PAD to PAD Time、建立時間、保持時間和時鐘到輸出延時等眾多時序特征向量密切相關(guān)。

發(fā)表于：2016/8/19

基于FPGA的多節(jié)點(diǎn)1553B總線協(xié)議處理器的實(shí)現(xiàn)

研究設(shè)計(jì)了一種多節(jié)點(diǎn)的1553B總線協(xié)議處理器，可以模擬整套1553B總線系統(tǒng)，既可以作為測試設(shè)備，也可作為總線上的多個節(jié)點(diǎn)在實(shí)際應(yīng)用中使用。針對總線協(xié)議處理器邏輯與存儲資源占用高、難以單片實(shí)現(xiàn)的問題，提出了多核MIMD架構(gòu)的實(shí)現(xiàn)思路，有效地降低了邏輯資源的使用量，使其可以在單片F(xiàn)PGA上實(shí)現(xiàn)?；谲浻布诤系睦砟?，通過自定義專用指令集增加指令并行度來提高指令執(zhí)行的效率，增強(qiáng)了系統(tǒng)的實(shí)時性，使其可以在低頻時鐘下運(yùn)行，從而降低了系統(tǒng)的功耗。

發(fā)表于：2016/8/19

基于FPGA的線陣CCD圖像采集與顯示系統(tǒng)設(shè)計(jì)

色選機(jī)廣泛應(yīng)用于工農(nóng)業(yè)產(chǎn)品檢測中，其設(shè)計(jì)技術(shù)涉及圖像采集、處理與顯示，常見的設(shè)計(jì)方案為FPGA+DSP/ARM+PC。該方案結(jié)構(gòu)復(fù)雜，成本高昂。設(shè)計(jì)了一種在FPGA中實(shí)現(xiàn)線陣CCD圖像信號采集并顯示的系統(tǒng)。添加圖像處理算法后，色選機(jī)的主要設(shè)計(jì)技術(shù)將被集成在一片F(xiàn)PGA芯片中。詳細(xì)闡述了圖像采集與顯示的邏輯設(shè)計(jì)，并通過軟硬件調(diào)試驗(yàn)證了設(shè)計(jì)的正確性。該系統(tǒng)結(jié)構(gòu)簡單、成本低廉，經(jīng)過適當(dāng)移植，可應(yīng)用于安檢、醫(yī)療影像等領(lǐng)域。

發(fā)表于：2016/8/11

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