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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問題，設(shè)備可以在那里重新編程。

基于FPGA的仿人機(jī)器人面部驅(qū)動(dòng)系統(tǒng)

針對(duì)單片機(jī)在處理多任務(wù)事件時(shí)的延時(shí)問題，提出了基于現(xiàn)場(chǎng)可編程門陣列(FPGA)的驅(qū)動(dòng)系統(tǒng)設(shè)計(jì)方案。根據(jù)FPGA的多任務(wù)可并行處理特點(diǎn)，分別進(jìn)行設(shè)計(jì)和驗(yàn)證并通過在一片F(xiàn)PGA上統(tǒng)一實(shí)例化模塊，簡化了驅(qū)動(dòng)系統(tǒng)的硬件結(jié)構(gòu)。實(shí)驗(yàn)表明，基于FPGA的驅(qū)動(dòng)系統(tǒng)可有效提高面部表情控制準(zhǔn)確度和表情再現(xiàn)速率。

發(fā)表于：8/15/2013

行業(yè)首個(gè)ASIC級(jí)架構(gòu):UltraScale 架構(gòu)

需要?jiǎng)?chuàng)新架構(gòu)方法來管理支持全面線路速率智能處理的每秒數(shù)百 Gb 級(jí)系統(tǒng)性能，將其擴(kuò)展至 TB 乃至每秒萬億次性能水平。不僅要提升每個(gè)晶體管或系統(tǒng)模塊的性能，或擴(kuò)展系統(tǒng)中模塊的數(shù)量，同時(shí)還要從根本上改進(jìn)通信、時(shí)鐘、重要路徑與互聯(lián)，充分滿足海量數(shù)據(jù)流與智能數(shù)據(jù)包、DSP 和／或線路速率圖形處理需求。

發(fā)表于：8/8/2013

基于FT245BM和FPGA的數(shù)據(jù)采集設(shè)計(jì)

基于FT245BM和FPGA設(shè)計(jì)了一個(gè)高速數(shù)據(jù)采集系統(tǒng)。主控制器采用MCU和FPGA，MCU通過串口接收PC機(jī)打包發(fā)送的命令，通過主控模塊控制AD采集信號(hào)，在FPGA中形成數(shù)據(jù)流，并通過USB總線傳輸給PC機(jī)。此設(shè)計(jì)簡化了USB通信，提高了軟件編寫效率，減少了電子元器件的使用。經(jīng)過PC機(jī)軟件測(cè)試，PC機(jī)采集到的數(shù)據(jù)和原輸入數(shù)據(jù)變化趨勢(shì)基本一致，符合設(shè)計(jì)要求。

發(fā)表于：8/8/2013

遠(yuǎn)程數(shù)字圖像監(jiān)控系統(tǒng)的FPGA實(shí)現(xiàn)

以現(xiàn)場(chǎng)可編程門陣列(FPGA)為中央處理器，融合CMOS圖像傳感器技術(shù)、無線網(wǎng)絡(luò)傳輸技術(shù)和彩色圖像處理技術(shù)等，設(shè)計(jì)一套集圖像采集、預(yù)處理、壓縮和傳輸為一體的遠(yuǎn)程圖像監(jiān)控系統(tǒng)。借助硬件可編程邏輯語言現(xiàn)場(chǎng)配置D5M數(shù)碼相機(jī)開發(fā)套件，及基于串口的GPRS數(shù)據(jù)傳輸模塊，并對(duì)彩色數(shù)字圖像進(jìn)行小波壓縮處理，最終完成對(duì)現(xiàn)場(chǎng)圖像的遠(yuǎn)程監(jiān)控。

發(fā)表于：8/8/2013

基于Walsh函數(shù)的同時(shí)多頻信號(hào)采集系統(tǒng)設(shè)計(jì)

為獲得不同組織、器官在同一時(shí)間不同頻率下的阻抗值，設(shè)計(jì)了一套基于Walsh函數(shù)的同時(shí)多頻信號(hào)數(shù)據(jù)采集系統(tǒng)。設(shè)計(jì)中選用AD9240作為A/D轉(zhuǎn)換芯片，利用Cyclone IV EP4CE115F29C7N FPGA構(gòu)造FIFO作為采樣數(shù)據(jù)的緩存器，通過串口將FIFO中的數(shù)據(jù)傳輸?shù)接?jì)算機(jī)進(jìn)行波形的恢復(fù)。實(shí)驗(yàn)結(jié)果表明，系統(tǒng)能正確采集同時(shí)多頻信號(hào)。

發(fā)表于：8/6/2013

Altera在亞洲10城市2013技術(shù)巡展上展示最新FPGA和SoC解決方案

Altera®公司今天宣布，從2013年8月到10月，將在亞太地區(qū)的10個(gè)城市舉辦Altera 2013技術(shù)巡展，這是免費(fèi)的技術(shù)研討會(huì)，展示最新FPGA、SoC技術(shù)和開發(fā)環(huán)境。研討會(huì)將在以下地區(qū)舉行：中國、韓國、馬來西亞、新加坡、臺(tái)灣和印度。

發(fā)表于：8/6/2013

賽靈思FPGA可顯著提升波束成形系統(tǒng)設(shè)計(jì)

波波束形成是一種利用一系列傳感器實(shí)現(xiàn)方向性、提高發(fā)送信號(hào)強(qiáng)度以及提升接收信號(hào)質(zhì)量的信號(hào)處理技術(shù)。通信、雷達(dá)、對(duì)抗措施、武器系統(tǒng)、石油與礦產(chǎn)勘探、醫(yī)療成像及測(cè)向等領(lǐng)域均廣泛使用了波束形成技術(shù)。在測(cè)向應(yīng)

發(fā)表于：8/5/2013

新的工具可簡化FPGA綜合

大多數(shù)FPGA設(shè)計(jì)人員都充滿熱情地開展專業(yè)化問題解決和創(chuàng)造性工作，當(dāng)然，他們工作壓力也相當(dāng)大，工作流程也非常單調(diào)乏味。幸運(yùn)的是，EDA公司和FPGA廠商不斷開發(fā)新的工具和方法，推進(jìn)繁瑣任務(wù)的自動(dòng)化，幫助設(shè)

發(fā)表于：8/5/2013

基于FPGA的多功能生物電信號(hào)檢測(cè)系統(tǒng)

設(shè)計(jì)了一款基于FPGA的多功能生物電信號(hào)檢測(cè)系統(tǒng)，通過更換不同的前置模擬盒對(duì)神經(jīng)肌電信號(hào)、心電信號(hào)、表面肌電信號(hào)進(jìn)行檢測(cè)和分析。系統(tǒng)模擬電路與數(shù)字電路緊密結(jié)合，F(xiàn)PGA采用硬件電路與Nios嵌入式軟件協(xié)同設(shè)計(jì)，實(shí)現(xiàn)了對(duì)生物電信號(hào)的采集、處理、存儲(chǔ)、顯示和分析。

發(fā)表于：8/2/2013

Altera演示Cavium OCTEON®多核處理器的Interlaken互聯(lián)

Altera公司(NASDAQ: ALTR)今天宣布，Stratix® V FPGA的Interlaken知識(shí)產(chǎn)權(quán)(IP)內(nèi)核實(shí)現(xiàn)了與Cavium OCTEON多核處理器的互操作。這一成功的工作保證了芯片至芯片前端互聯(lián)，更方便OEM做出器件選擇決定。

發(fā)表于：8/1/2013

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